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verilog出租车计价器

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毕高严 发表于 2020-12-31 20:26:59 | 显示全部楼层 |阅读模式 打印 上一主题 下一主题
出租车计价器由以下几个模块组成:
1、速度产生模块
module velocity(clk,rst,en_1,en_2,F_1HZ,frequency );
2、速度判断模块
module judge_v(rst,frequency,F_1HZ,en_1,en_2,v_h,v_l);
3、路程模块
module kilometer(rst,frequency,start,stop,distance_q,distance_b,distance_s,distance_g);
4、时间模块
module clock(F_1HZ,rst,start,stop,en1,en2,time_h,time_t,time_o,flag_1min,T_goes);
5、代价模块
Module price(clk,rst,start,stop,v_h,v_l,flag_1min,distance_b,distance_s,flag,money_q,money_b,
money_s,money_g);
6、VGA模块
module VGA_disp (clk,rst,time_h,time_t,time_o,money_q,money_b,money_s,money_g,distance_q,
distance_b,distance_s,distance_g,hs, vs,vga_r,vga_g,vga_b);
 
功能验证方案及仿真结果图:
1、速度产生模块验证方案及仿真图
1)起始状态en1为1,en2为0,frequency的输出波形应该为0.5HZ, F_1HZ的输出波形应该为1HZ。
2)下一个状态en1为0,en2为1,frequency的输出波形应该为2HZ, F_1HZ的输出波形应该为1HZ。
3)观察波形与预期波形一致,完成该模块验证

由图可以看出,当输入状态en1为1,en2为0时,frequency的输出波形为0.5HZ, F_1HZ的输出波形为1HZ。当输入状态en1为0,en2为1时,frequency的输出波形为2HZ, F_1HZ的输出波形为1HZ。
2、速度判断模块验证方案及仿真图

  • 初始状态给F_1HZ10个延迟单位(即#10),frequency给5延迟单位(即#5),对应汽车频率比标准频率快,即汽车速度高于标准速度,所以应该v_l为0,v_h为1.
  • 初始状态给F_1HZ10个延迟单位(即#10),frequency给15延迟单位(即#15),对应汽车频率比标准频率慢,即汽车速度低于标准速度,所以应该v_l为1,v_h为0.
  • 观察波形图,与预期波形一致,完成验证。

由图可以看出,汽车速度低于标准速度时,输出v_h=1,v_l=0。
其余的仿真没有放在这,有详细的实验陈诉和源代码及注释,另有其他的模块的仿真图。

来源:https://blog.csdn.net/QQ_778132974/article/details/111997957
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